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如何调整时钟芯片Si5338输出频偏?

时钟芯片Si5338可以通过调整pin脚或寄存器来调整频偏。

2016-10-25 -  技术问答 代理服务 技术支持 采购服务

时钟芯片Si5338如何调整输出的相位?

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2016-10-25 -  技术问答 代理服务 技术支持 采购服务

时钟芯片Si5338输出频偏调整精度是多少?

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2016-10-25 -  技术问答 代理服务 技术支持 采购服务

时钟芯片Si5338最多可以支持几路时钟输出?

时钟芯片Si5338最多可以支持8路时钟输出。

2017-05-05 -  技术问答 代理服务 技术支持 采购服务

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2016-10-25 -  技术问答 代理服务 技术支持 采购服务

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2016-08-13 -  新产品 代理服务 技术支持 采购服务

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2020-01-01 -  新产品 代理服务 技术支持 采购服务

【经验】如何优化时钟芯片Si5395P以保证高精度时钟输出?

为了进一步降低56G/112G PAM4 高速SerDes接口在各种数据通信设备中应用时的抖动需求,以实现更高速率、更大带宽的高速以太网和光传输设计,Silicon Labs公司推出了性能更佳的Si5395P时钟芯片。Si5395P对各个输出做了详细的优化,以更好地降低额外的抖动,本文就将详细说明如何规划各个输出时钟频点以保证高精度时钟输出。

2020-07-31 -  设计经验 代理服务 技术支持 采购服务

【经验】高性能抖动衰减器时钟芯片Si5326的频率配置问题解析及替代方案推荐

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2020-03-10 -  设计经验 代理服务 技术支持 采购服务

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Si5381内部自带4个独立的DSPLL,其中专门为实现无线基站设备时钟配置的锁相环是DSPLLB,DSPLLB的输出范围最高可达1.47456 GHz,环路带宽范围是10 Hz ~ 100 Hz,支持高速接口JESD204B的DCLK 和 SYSREF时钟处理。其它DSPLLA/C/D可以作为普通时钟发生器DSPLL使用,其输出范围和带宽范围相对DSPLLB要窄,可以作为普通本地总线、交换芯片等设备的参考钟使用。

2016-10-24 -  技术问答 代理服务 技术支持 采购服务

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2019-09-05 -  新应用 代理服务 技术支持 采购服务

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2016-09-22 -  设计经验 代理服务 技术支持 采购服务

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2017-10-16 -  新应用 代理服务 技术支持 采购服务
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