【经验】SI5346去抖时钟芯片两种常见环路失锁的原因分析

时间： 2019-05-28 来源：世强

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SI5346是一款常用的去抖时钟芯片，其最佳RMS JITTER指标可以达到65fs，在业界遥遥领先。这得益于其内部基于第四代DSPLL专利技术的架构设计，SI5346内置两个数字锁相环，4路输出，最大支持712.5MHz输出频率，自带I2C、SPI可编程接口，能够实现在线编程改变输出频率,目前已经广泛用于各种数据通信产品中，包括骨干网、移动回传网等设备中，应用场景越来越广泛。

由于使用的面非常广，因此经常碰到各种DSPLL失锁问题，且应用环境各种各样，即使采用原厂文档推荐的参考电路，也会存在硬件或者软件配置问题导致的失锁问题，下面是近期陪同工程师调试时就碰到两种常见的失锁问题。

问题1：工程师在测试时，上电初始化无时钟输出，输出电平全为高电平，读取状态寄存器，读相关锁定状态寄存器LOL发现一直失锁，也没有进入free run和holdover，检查无输入源LOS，无输入源OOF频偏告警，同时读取0xF寄存器发现环路1和环路2均处于校准状态，无法锁定输入源。

1、分别检查外围电路设计，排除了电源影响。检查输入信号匹配电路，没有发现问题。检查了XAXB的晶振，晶振输出正常，排除XAXB晶振问题。

2、检查客户配置文件，并对比CBPro软件导出的配置文件，发现客户初始化代码存在一定问题，由于客户使用的是B版本SI5346，其初始化代码流程需要首先配置功能寄存器0X0B24、0X0B25等寄存器，这个寄存器的值是在所有B版本初始化时必须在配置前分别写0XD8和0X00，在配置后再分别改成0XDB和0X02，完成配置，而错误的配置是将0X0B24、0X0B25的寄存器分别配置成了0XC0和0X00，导致芯片初始化失败，使得SI5346芯片内部逻辑混乱，从而导致锁相环直接进入到长期校准状态。实测将寄存器改回后，可以正常输出，问题解决。

问题2：用户新焊接了几块测试板，上电初始化后出现了上述问题1的类似现象。

同样检查外围电路设计，没有发现电源问题，电源的纹波在SI5346要求的范围内。进一步检查发现SI5346的XA/XB晶振频点为40MHz，而实际使用的CBPro工程文件对应的XA/XB频点是48MHz，频偏误差远远超过100 ppm，导致SI5346内部的数字锁相环无法正常识别，其DCO的频点就会不稳，从而导致其锁相环失锁，处于不停的校准状态。实测更换正确的晶振后，问题解决。

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全部评论（7）

沉浮 Lv7. 资深专家 2019-05-28

学习
duanmaxie Lv8. 研究员 2019-05-28

学习
桃梅 Lv7. 资深专家 2019-05-28

学习，下载
用户56731903 Lv9. 科学家 2019-05-28

学习了！！！
maomao Lv8. 研究员 2019-05-28

支持了~

棒棒猫 Lv6. 高级专家 2019-05-28

不错哦
好运常伴吾 Lv8. 研究员 2019-05-28

学习

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