【产品】输出频率为10MHz~945MHz的压控晶振

2018-03-06 SILICON LABS(世强编辑整理) 学徒超超
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SILICON LABS新推出压控晶振Si552,采用先进的第三代DSPLL技术,提供超低抖动的时钟信号,其中周期抖动仅为2ps(有效值),简化了通信系统在嘈杂环境中的时钟设计。


不同于传统压控晶振,Si552采用固定晶体提供宽范围的输出频率,具有CMOS、LVPECL、LVDS和CML四种输出类型,标称频率分别为10MHz~945MHz(LVDS/CML/LVPECL)、10MHz~160MHz(CMOS),满足用户多样化的设计需求。控制电压线性度最低为±5%(BSL),控制斜率为33ppm/V~356ppm/V,实现灵活的输出频率控制。此外,该元件还提供优秀的频率稳定性,相比SAW振荡器提高3倍。温度稳定性不超过±100ppm,并且15年后的频率老化率仅为±10ppm,有助于延长设备使用寿命。


Si552工作温度为-40℃~85℃,ESD灵敏度高达2.5kV(人体模型),确保设备运行时的可靠性。该元件还能根据用户需求进行定制,包括频率、电源电压、输出格式、控制斜率和温度稳定性。


图1 Si552实物图


Si552主要特点:

·提供10MHz~945MHz范围内的任意输出频率,可选频率高达1.4GHz

·两个可选输出频率

·具有优秀抖动性能的第三代DSPLL技术

·相比SAW振荡器频率稳定性提高3倍

·内部固定晶体频率确保高可靠性和低老化率

·CMOS、LVPECL、LVDS和CML输出可选

·3.3V、2.5V、1.8 V电源选项

·5mm×7mm工业标准封装和引脚

·无铅/符合RoHS标准


Si552典型应用:

·SONET/SDH

·xDSL

·10GbE LAN/WAN

·低抖动时钟生成

·光学模块

·时钟和数据恢复


技术顾问:搬砖的奶爸


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全部评论(5

  • 希望的风 Lv8. 研究员 2018-08-23
    现在的世强产品越来越丰富
  • 滨海养老会所 Lv7. 资深专家 2018-08-18
    以为只有IC
  • YKS Lv3. 高级工程师 2018-07-12
    学习了
  • Regan Lv6. 高级专家 2018-05-07
    学习
  • YoungKing Lv7. 资深专家 2018-03-06
    学习了
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Silicon Labs(芯科科技) 用于Xilinx FPGAs的定时解决方案

型号- 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应用及方案  -  SILICON LABS  - 2017年07月17日 PDF 英文 下载

【技术大神】论时钟电路设计中时钟芯片的重要性

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设计经验    发布时间 : 2016-09-22

时钟树设计原则你还不造 来get一下吧

在进行时钟树设计时,“一成不变”的策略并不适用,优化时钟树以满足性能和成本的要求取决于多种因素,包括系统架构、集成电路(IC)时序需求(频率、信号格式等)和终端应用的抖动需求。

设计经验    发布时间 : 2019-09-03

【技术大神】Femto TD-LTE基站产品时钟设计注意要点

本文讲的是基于Si5338芯片的Femto TD-LTE基站产品的时钟设计项目,该芯片是一款支持iic管理的4路时钟生成器芯片,该芯片可以输出0.16MHz至350MHz任意频率时钟信号。

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【产品】牵引范围可达±50ppm的压控晶振和网络通信设备更搭

VG-4232CA采用了PLL锁相环技术,具有高频率稳定性,且低功耗和小封装的特点更适合便携式网络通信设备。

新产品    发布时间 : 2017-06-11

【产品】抖动时间小于50ps的CY28800低抖动差分缓冲器,为PCI Express和SATA通信保驾护航

Silicon Labs(芯科实验室有限公司)发布了一款低抖动差分缓冲器——CY28800,该器件CTC抖动时间小于50ps,可以作为CK409和CK410的配套器件使用。CY28800具有8组0.7V的差分时钟输出,采用OE_INV输入实现OE,PWRDWN以及 SRC_STP活动电平的翻转,同时该产品具有可编程的带宽,扩展了产品的使用范围。

新产品    发布时间 : 2019-07-04

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