【经验】解析瑞萨R CAR V3M LVDS显示输出模块du输入时钟调试经验
采用瑞萨R CAR V3M开发DMS、CMS项目时,通过LVDS显示输出,屏的分辨率为1280*768 60帧,针对这个分辨率如何来选择是采用外部DU_DOTCLKIN还是内部du clk呢,以及如何配置使其频率符合液晶屏的规格呢,本文详细记录调试中需要注意的关键点。
首先需要确认屏的规格,通常屏的pclk规格都是有一个范围的,即行场都有消隐区,前后肩,有些屏最小到最大有几十兆的范围,也有一些只有几兆,中间有一个典型值。
可以看到上面屏的规格,有效行场像素为1280X768,htotal,vtotal最小为1309,775对应的pclk是60.9MHZ,htotal,vtotal最大为1664,998对应的pclk是85MHZ,htotal,vtotal典型为1322,781对应的pclk是61.9MHZ。
第二步看一下R CAR V3M的du clk部分
Dot clock setting中说明了可以选择外部晶振输入给DU_DOTCLKIN0,也可以选择内部分频,通过如下寄存器
DCLKSEL为设置是外部提供时钟还是内部的。
分频系数为2-64,R CAR V3M的内部时钟源为S2D1ϕ,为266.66MHZ
所以如果采用内部时钟,最大2分频,就是133.33MHZ,次之88.8866MHZ,66.665MHZ等,可以看到4分频是可以满足以上屏的规格的。
而如果采用外部时钟的话,可以用148.5MHZ的晶振,然后通过2分频提供74.25MHZ:
如此就完成了R CAR V3M的LVDS输出时钟的选择以及配置,从而成功驱动显示输出。
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