【经验】Renesas时钟发生器5P49V6965为实现高稳定时钟输出的设计注意事项

时间： 2022-10-04 来源：世强

技术问答

5P49V6965是可编程时钟发生器，内置有4组OTP，可通过固化频率计划，上电即可实现频率输出，也支持IIC每次上电配置，支持外部时钟或晶振输入，输出多达4路差分或8路单端输出，超低抖动，广泛应用于服务器等设备上。本文将介绍时钟发生器5P49V6965在设计时的注意事项，实现高稳定的时钟输出。

1、pin4为晶振或外部时钟输入，pin4对输入的时钟有摆幅的要求，使摆幅在1.2V以下。

2、可通过以下的设计参考，增加分压电路，满足输入的摆幅要求。

3、在输入时钟失锁的情况下，可通过以下的寄存器，让VCO重新校准，让时钟重新锁定。

工程师们可以通过以上的方式设计，充分发挥RENESAS 5P49V6965时钟的优良性能。

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