【应用】Silicon Labs为Altera FPGA提供时钟解决方案

时间： 2019-06-23 来源：Silicon Labs

技术问答

SILICON LABS提供广泛的频率灵活的抖动衰减时钟，时钟发生器，时钟缓冲器和振荡器产品，使硬件设计人员能够简化时钟合成和分配。Silicon Labs时钟使用专有的DSPLL和MultiSynth技术生成低抖动的任何频率/格式组合。时钟缓冲器提供集成的格式/电压电平转换，并且符合PCIe标准。

时钟芯片的特性

任意频率合成

超低抖动

更少的外部器件

更少、更可靠的交付时间

高电源抑制比

Stratix V GX FPGA的时钟参考设计方案如下所示：

Altera参考设计方案

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