【经验】一种关于SI5347去抖时钟发生器告警信号的处理方法
SILICON LABS推出的高性能Timing产品去抖时钟发生器SI5347目前在光通信、数据通信、医疗器械等领域中大量应用。SI5347内置4个DSPLL，可以提供高达10路差分（20路单端）时钟信号的输出，且可以控制输出时钟的抖动在100fs以内，去抖能力业界遥遥领先，SI5347自带编程接口，支持官方定制和用户自定义配置方式实现频率输出，配置流程非常简便。目前大部分工程师都是自行通过CBPro软件配置SI5347的频率计划，以实现多种频率的前期调试。
在配置频率计划时，用户常碰到多种告警，这些告警都会牵扯到频率的输出，很多告警则直接影响到输出频率的jitter指标，进而影响输出信号的相噪，影响后级芯片的工作，因此必须引起重视。
下面是一款使用SI5347的用户碰到的告警问题，该用户没有注意这个告警的处理，直接将对应配置下载到使用SI5347的通信设备中，实测发现通信业务有较大误码率，直接影响到了设备正常测试运行。该用户对应的频率计划如下，输入IN0和IN1分别是156.25MHz和19.2MHz，参考时钟选择54MHz有源晶振，输出184.32MHz、125MHz等频点用于后端DAC、GMII接口时钟处理。在下载初始化成功后，也检查了锁相环状态（LOL、LOS、OOF），确定全部正常，以为没有问题，在发现通信有大量误码时重新测试SI5347的输出时钟，发现其Phase Jitter值远远大于官方提供的数据，达到了ps级别，SI5347公布的官方数据是95fs，且输出在12kHz~20MHz范围内存在多处Spur，即使由于测试手段不同，也不会与官方数据存在太大差异。
在发现该问题后，首先协助检查了客户的原理图，确定原理图没有问题。之后检查了客户的CBPro工程配置文件，发现存在下述告警。
该告警指示小数分频的鉴相频率为1.999MHz，Jitter性能可能比较牵强，而达不到设计需求，因此输出的相噪即通信的高误码问题可能来自于这个告警。
对于这个告警产生的原因，可能跟输入有关，即两个输入配置后导致给PD鉴相器的输入频率达不到可以优化Jitter的最低指标，SI5347是单DSPLL，需要同时保证两个输入同时满足鉴相需求，很明显156.25MHz和19.2MHz不能同时满足这一需求，实测将两者中的任意一路输入关闭后，告警即消失，这时再测试整个通信业务，就没有前期大量误码的问题。咨询了客户，目前只使用156.25MHz作为输入，修改后问题解决。
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