【经验】高性能去抖时钟发生器Si5347输入输出延时调整功能的应用注意事项
SILICON LABS Si5347是一款内置4个DSPLL的高性能去抖时钟发生器，支持多个输出频点的异步和同步输出，是实现非相干设计或者源同步设计的经典时钟芯片。因为是DSPLL，且工具常用的需求，特别是在某些控制系统和高速接口时钟数据相位对齐功能的需求时，需要增加延时调节功能，因此Si5347也实时增加了该I/O延时调节功能（即输入输出延时调整功能）。
如果需要调节功能，需要打开ClockBuilder Pro的工程文件，在第11步骤设置下使能对应的锁相环的输出延时调整功能（如下图1）。但是实际使用时候，因为在ClockBuilder Pro的前几步骤设置时，已经将频率计划的输入和输出主要参数值确定了，当使能某个DSPLLx的延时使能调整功能时，可能会碰到问题，因此必须要了解该I/O Delay功能的一些主要设置限制条件。
图1 ClockBuilder Pro关于I/O DELAY的设置界面
这些设置条件包括：
1、这些延时时钟针对某一个DSPLLx设置的，各个DSPLLx是相互独立的，但是针对各个输出不一定独立。如果某个DSPLLx同时又几路输出，那么调整时会同时调整该DSPLLx所关联的所有输出端口延时调整。
2、延时调整范围最大为±4 ns，但是也会随实际的频率设置而异，在使能后，会显示I/O 延时范围。
3、Si5347的延时步进为0.1 ns，更改相应的寄存器后需要实时软复位对应的环路实现I/O延时功能。
4、Fpfd的鉴相频率必须限制在32kHz以下，在使能I/O延时功能时，会自动修改Fpfd到对应的值，如果修改32kHz以下后没和合适的频率计划可以实现，则表示延时功能也无法实现（软件会以报错的方式告知）。
5、会关闭无缝切换功能。如果要实现无缝切换功能，则I/O延时功能无法正常开启。
6、必须要要求对应的Fdco达到1.2GHz，同时给到DSPLLx的频率合成器分频值Mux=Pxn/Pxd必须为整数，不支持小数分频功能的延时调整。
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