【经验】Silicon Labs时钟发生器SI5332时钟差分信号变单端输出问题及处理方法

时间： 2022-03-21 来源：世强

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SILICON LABS 时钟发生器 SI5332具有灵活的时钟频率输出、可选的电平格式和可选独立电压输出，可产生高达12中时钟频率输出相较于单频率输出的晶体振荡器可大大减少PCB的面积，广泛运用于5G基站、FPGA中提供时钟基准源。SI5332可支持差分信号5MHz至312.5MHz、单端信号LVCMOS：5MHz至170MHz、用户可根据各种输出配置时钟输出信号格式：LVDS、LVPECL、HCSL、LVCMOS。

在使用CB Pro软件配置好电平之后，有工程师会有疑问，原本配置好的3.3V 125MHz lVDS电平 OUT/OUTB是否可以在配置不动的情况下单独分开做两个125MHZ单端时钟输出？

在配置不动的情况下，差分电平是不可直接实现两路独立的单端电平输出，原因是差分与单端的摆幅电平不同，一般Lvds摆幅电平为300多mV，与单端信号摆幅电平相比，摆幅远远不够，到不了VIH，不会被判为输入逻辑1，数据会误判。

因此需要修改频率配置，Silicon Labs有专门的CB Pro软件，修改配置十分简便，在可用的NVM空间中，可支持多次烧录，可大大减少研发周期。

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