【应用】瑞萨时钟芯片可轻松实现以太网时钟设计，RMS jitter＜0.3ps，相位抖动性能良好
随着5G大容量新需求，OTN技术已经顺势要求下沉到接入网，OTN盒子、OTN小型化设备广泛应用于接入网设备中，实现数据大带宽互联互通，满足特定企业、电信专线通信的需求。
接入网的设备离不开以太网交换设计，比如常见的万兆（10G）、千兆（1G/1000M）、100兆以太网，这些都会应用到小型化OTN设备中。这些以太网MAC/PHY芯片常用的接口是一些高速接口，比如常见的XGMII、RGMII、MII等等，这些接口都是高速的并行接口，需要同步随路一个发送时钟，因此这些芯片（或者FPGA）都需要对应的以太网参考时钟。其中OTN盒子就是一款需要支持万兆以太网/千兆以太网接口的一款设备，对于这些以太网时钟设计，这里我们推荐使用瑞萨（RENESAS）的一颗843N571BKILF时钟合成器作为参考设计，实现以太网时钟树的设计（如下图）。
图1 基于843N571BKILF时钟芯片的以太网时钟树设计
843N571BKILF是一个基于锁相环的时钟发生器，通常用于以太网应用。该设备使用IDT的第四代FemtoCLock®NG技术，结合低功耗和高电源噪声抑制，以获得最佳的高时钟频率和低相位噪声性能，同时843N571BKILF的RMS jitter可以达到<0.3ps，具有良好相位抖动性能，843N571BKILF之所以通常用于以太网通信设备设计，主要也是因为它可以轻松合成100MHz, 125MHz, 156.25MHz常用的以太网时钟和一个低频33.33MHz的CPU时钟输出，此外还提供6个LVCMOS输出也作为25MHz晶体参考的额外缓冲输出，可以提供给其它低速PHY或者CPLD等器件的时钟，使用十分方便。
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