应用级抖动优化，低于 1 ps 的抖动衰减器无惧光网络挑战

时间： 2019-07-02 来源：世强

技术问答

SILICON LABS是全球领先的高性能模拟与混合信号IC供应商之一。本次，Silicon Labs 为我们带来其最佳性能、最高集成度的时钟抖动衰减器 Si5374，以应对具备复杂时钟要求的高速光传输网络（OTN）应用。利用Silicon Labs的专利技术DSPLL技术，它所提供的PLL集成是其它竞争解决方案的两倍，抖动降低了40%。

图1：Si5374实物图

Si5374 是一款四路 DSPLL、8 输出、任意频率 (<808MHz)、任意输出的抖动衰减器，适用于需要低于 1 ps 抖动性能的应用。Si5374 利用任意输入频率生成 350 fs rms 典型抖动性能的任意输出频率。Si5374 还可以把其晶体振荡器作为时钟源进行频率合成，输入时钟频率和时钟倍频比率可通过 I2C 接口进行编程。Si5374 基于 Silicon Laboratories 的第三代 DSPLL® 技术，可以在高度集成的 PLL 解决方案中实现频率合成和抖动衰减，不需要外部 VCXO 和环路滤波器元件。DSPLL 环路带宽可进行数字编程，进行应用级别的抖动性能优化。

OTN应用面临着复杂的时钟挑战，因为它需要多个非整数相关（non-integer-related）频率的低抖动时钟。Silicon Labs Si5374元器件有四路独立的DSPLL，可产生多达八个超低抖动输出时钟，简化任何协议、任意端口的10G、40G和100G OTN线卡设计。Si5374不需要分隔上行低带宽PLL，即可精准地锁定间隔的时钟输入，而这也是OTN线路卡对时钟的重要要求。

Silicon Labs定时产品总经理Mike Petrowski表示：“OTN上高带宽数据、影音服务的流量以及光学线卡接端口密度与日俱增，而这都需要更高度的时钟集成与超低的抖动，才能把设计成本与复杂度降到最低。Silicon Labs新推出的Si5374时钟IC具有业界最低抖动，相对其它竞争方案可提供更强大的高性能PLL集成能力，为当前专为OTN而设计的时钟解决方案设立了新标竿。”

Si5374产品特点：
• 高度集成，4PLL时钟抖动衰减器
• 4路独立DSPLL支持任意频率合成和抖动衰减
• 超低抖动时钟输出：350 fs rms (12 kHz–20 MHz) 和410 fs rms (50 kHz–80 MHz）
• 自动/手动无输入时钟切换
• 可通过I2C编程

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全部评论（2）

WallE Lv7. 资深专家 2017-12-31

光网终于可以有盼头了
闲云 Lv7. 资深专家 2017-11-09

好东西！

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