【产品】超低相位噪声四/双PLL——Si5380高性能时钟发生器，无需配置外部VCXO和环路滤波器元件

时间： 2018-12-14 来源：Silicon Labs

技术问答

SILICON LABS（芯科科技）推出的Si5380是一款基于整数 (M/N) 的高性能时钟发生器，适用于要求最高级别集成度和相位噪声性能的小型基站应用。Si5380 采用 Silicon Laboratories 的第四代 DSPLL 技术，将频率合成与抖动衰减完美地融入至一个高度集成的数字解决方案中，无需配置外部VCXO 和环路滤波器元件。低成本的固定频率晶体能够在自由运行和保持模式下提供频率稳定性。这种全数字解决方案提供出色的性能，具有极强的抗外部电路板干扰（比如电源噪声）的能力。

Si5380时钟发生器主要特点：

•借助于数字频率合成，无需配置外部 VCXO和模拟环路滤波器元件

•支持 JESD204B 时钟： DCLK 和 SYSREF

•输入频率范围：

•差分： 10 MHz – 750 MHz

•LVCMOS： 10 MHz – 250 MHz

•输出频率范围：

•差分： 480 kHz – 1.47456 GHz

•LVCMOS： 480 kHz – 250 MHz

Si5380时钟发生器应用：

•JESD204B 时钟生成

•远端射频单元 (RRU)、远端存取网路(RAN)、微微蜂窝基站、小型基站

•无线基站（3G、GSM、W-CDMA、4G/LTE、LTE-A）

•远端射频头 (RRH)、无线中继器、无线回程

•数据转换采样时钟（ADC、DAC、DDC、DUC）

Si5380时钟发生器功能：

•借助于数字频率合成，无需配置外部 VCXO 和模拟环路滤波器元件

•支持 JESD204B 时钟： DCLK 和 SYSREF

•输入频率范围：

•差分： 10 MHz – 750 MHz

•LVCMOS： 10 MHz – 250 MHz

•输出频率范围：

•差分：高达 1.47456 GHz

•LVCMOS：高达 250 MHz

•出色的抖动性能：

•70 fs 典型值 (12 kHz – 20 MHz)

•相位本底噪声： –159 dBc/Hz

•杂散性能： –103 dBc 最大值（相对于 122.88 MHz 载波）

•可配置的输出：

•信号摆动： 200 至 3200 mVpp

•与 LVDS 和 LVPECL 兼容

•3.3、2.5 或 1.8 V LVCMOS

•输出至输出偏移： 20 ps（典型值，与 N 进制分频器相同）

•可调节的输出至输出延迟： 68 ps/阶进，±128 阶进

•可选的零延迟模式

•独立的输出时钟电源引脚： 3.3、2.5 或 1.8 V

•内核电压：

•VDD = 1.8 V ±5%

•VDDA = 3.3 V ±5%

•自动化自由运行、锁定和保持模式

•可选的数字化回路带宽 0.1 Hz 至 4 kHz

•输入时钟无缝切换

•状态监控（LOS、OOF、LOL）

•串行接口： I2C 或 SPI，在线可编程，具有非易失性 OTP 存储器

•ClockBuilderTM Pro 软件工具能够简化设备配置

•4 种输入、12 种输出、64 QFN

•温度范围： –40 至 +85 °C

•无铅、符合 RoHS-6

Si5380 是一款高性能时钟产生器，能够在设备的 12 种输出端中的任一端口与高达 10 个独特的整数倍频率合成。输出时钟能够在自由运行模式下生成，或者合成至四个外部输入端中的任一端口。 Silicon Laboratories 的第四代 DSPLL 技术可实现时钟生成，这种技术将频率合成与抖动衰减完美地融入至一个高度集成的数字解决方案中，无需配置外部 VCXO 和环路滤波器元件。 Si5380 设备可通过 I2C或 SPI 串行接口进行完全配置，采用在线可编程技术，具有非易失性存储器。

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本文由LEA酱的一生转载自Silicon Labs，原文标题为:Silicon Labs（芯科科技） Si5380时钟发生器数据手册（中文简略版），本站所有转载文章系出于传递更多信息之目的，且明确注明来源，不希望被转载的媒体或个人可与我们联系，我们将立即进行删除处理。

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