【产品】内置24992逻辑单元的低功耗FPGA器件SL2-25E/V，嵌入块存储容量9Kbits
西安智多晶微电子有限公司的Sealion（海狮）SL2-25E/V FPGA器件（下称“FPGA”），建立在一个优化的低功耗工艺基础之上，并提供最低的功耗，通过最低的成本实现较高的功能性。FPGA器件旨在用于大批量、成本敏感的应用，使系统设计师在降低成本的同时又能够满足不断增长的应用要求，在低成本、低功耗FPGA市场处于领导地位。对无线、有线、广播、工业用户以及通信等行业中的低成本的小型应用，本FPGA无疑是最理想的选择。
特性
丰富的逻辑资源
FPGA规模为24992逻辑单元（LUTs）
低功耗
优化的低功耗55nm工艺
核电压1.2V或3.3V
对大量丰富的并行处理资源的应用进行了重点优化
多逻辑单元以及布线资源
高性能可编程逻辑单元
采用LUT4查找表，可灵活地优化为LUT5/LUT6组合设计
灵活的资源可提升利用率
对逻辑单元操作模式的性能进行了优化，例如可创建算术模式，用于实现加法器、计数器、累加器和比较器。
内置硬核DSP
32/64内置多个18×18/9×9可串行乘法器以及算数逻辑单元（ALU），可做两层叠加实现DSP处理密集型应用
高达300MHz
支持分布式和嵌入式存储
嵌入块存储容量为9Kbits，可配置成单端口、伪双端口、真双端口以及FIFO缓冲器或者ROM，通过配置可实现多种数据宽度
最大支持768Kbits嵌入式存储器
丰富的时钟资源
最大频率Fmax=400MHz
最多可提供16个全局时钟，其中8个可以复用为高扇出网络
提供多达8个专用时钟输入引脚
2个5路时钟输出内置锁相环（PLL）提供倍频、分频、相位转移、展频等系统时钟功能
2个延时锁相环（DLL），提供分频、相位转移时钟功能
灵活强大的I/O单元
最高可达到336个有效用户I/O
支持400MbpsDDR2 SDRAM接口
支持Generic DDRx1, DDRx2
支持基频晶体（控制）振荡器（15~33MHz）在其IO块的Vccio=3.3V
输入输出支持3.3/2.5/1.8/1.5V电压
支持MIPI，接口速率高达1.2Gbps
I/O支持标准单端,差分, 伪双端包括LVTTL、LVCMOS、SSTL, HSTL、PCI, LVDS、BLVDS、mini-LVDS、RSDS
支持7:1 LVDS视频接口
8个IO块（Bank）
可配置上拉、下拉及总线保持模式
片内100欧姆差分电阻
支持热插拔
配置模式
主模式（Active Serial AS）
从模式（Passive Serial PS）
自刷新配置（Self Refresh Configuration SRC）
JTAG
配置过程支持SED多比特流检测、校验
配置过程支持多比特流加载，可在第一个程序文件加载失败后，自动跳到Golden区域加载第二个程序文件
安全与BSCAN
支持压缩及解压缩，其压缩比平均为3:1
兼容IEEE1149.1Boundary Scan（BSCAN）
封装
无铅封装
fBGA256，与Cyclone IV 10K BGA256管脚兼容
uBGA324
器件资源
【注】
1．管脚列表文件中的用户I/O管脚包括所有的通用I/O管脚、专用时钟管脚以及两用配置管脚。收发器管脚和专用配置管脚不包括在这一管脚列表中。每对I/O都存在真差分输入。
2．嵌入式18×18乘法器均为DSP硬核，可做乘法器兼累加器。
3．16个全局时钟均包含8个主时钟及8个次时钟。
4．等级：
C：商业级，结温温度：0℃~85℃
CI/I：工业级，结温温度：-40℃~100℃
器件结构
FPGA的核心构架由四输入查找表（LUTs）、逻辑单元存储器模块以及乘法器构成。嵌入式存储器模块具有9Kbit的SRAM存储器，可以把嵌入式存储器模块配置成单端口、伪双端口、真双端口RAM以及FIFO缓冲器或者ROM。嵌入式乘法器模块可以在单一模块中实现一个18×18或两个9×9乘法器。
FPGA器件的I/O支持可编程总线保持、可编程上拉电阻、可编程下拉电阻、可编程延迟、可编程驱动能力、可编程slew-rate控制以及热插拔的优化。FPGA器件同时还支持支持驱动阻抗匹配（Rs）。FPGA器件有PLL和DLL以及全局和辅助时钟网络以提供可靠、有效且低偏斜的时钟管理与综合。您可以在HqFpga软件中对PLL进行重配置时钟频率或者相位。支持SDR、DDR、DDR2等接口，并支持1.2Gbps真差分、MIPI、7:1 LVDS视频接口和基频晶体（控制）振荡器接口。接口可能位于器件的六个I/O模块（I/O bank），以实现更灵活的电路板设计。
FPGA器件SDR、DDR1/2SDRAM存储器接口解决方案，由一个PHY接口和一个存储控制器组成。智多晶提供了PHY接口IP，与顾客定制的存储控制器或智多晶提供的存储控制器一起使用。本FPGA具有先进编程功能如JTAG接口、被动串行接口（Passive Serial）、主动串行接口（Active Serial）和自刷新配置（Self Refresh Configuration SRC）。编程模块实现双重启动（dual boot)、eib boot）、安全性设置、错误检测（Soft Error Detection SED）、以及局部重配置（Partial Reconfiguration）。
封装特性
无铅，小型，多IO封装
17mm x 17mm fBGA256，多达186个单端口IO，与Cyclone IV 10K BGA256管脚兼容
15mm x 15mm uBGA324，多达242个单端口IO
优化的引脚排布，使得只需要两层PCB
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本文由圆明园驯兽师转载自智多晶，原文标题为:Sealion（海狮）SL2-25E/V FPGA数据手册，本站所有转载文章系出于传递更多信息之目的，且明确注明来源，不希望被转载的媒体或个人可与我们联系，我们将立即进行删除处理。
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