【产品】西安智多晶新推Sealion系列FPGA SL2E-7E/V，具有低成本、低功耗优势

2022-03-12 西安智多晶
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西安智多晶微电子有限公司的 Sealion（海狮）系列SL2E-7E/V FPGA 器件（下称“FPGA”），建立在一个优化的低功耗工艺基础之上，并提供最低的功耗，通过最低的成本实现较高的功能性。FPGA器件旨在用于大批量、成本敏感的应用，使系统设计师在降低成本的同时又能够满足不断增长的应用要求，在低成本、低功耗FPGA市场处于领导地位。对无线、有线、 广播、工业用户以及通信等行业中的低成本的小型应用，本 FPGA 无疑是理想的选择。


特性

FPGA 具有以下特性： 丰富的逻辑资源 

  •  FPGA 规模为6,864 逻辑单元(LUTs) 

低功耗 

  •  优化的低功耗 55nm 工艺 

  •  核电压 1.2/3.3V 

  •  对大量丰富的并行处理资源的应用进行了重点优化 

  •  多逻辑单元以及布线资源 

高性能可编程逻辑单元 

  •  采用 LUT4 查找表，可灵活地优化为 LUT5/LUT6 组合设计 

  •  灵活的资源可提升利用率 

  •  对逻辑单元操作模式的性能进行了优 化，例如可创建算术模式，用于实现 加法器、计数器、累加器和比较器。

内置 Flash

  •  无须外部配置电路 

  •  支持快速上电启动 

  •  最大用户区域为 500Kbits 

支持分布式和嵌入式存储 

  • 嵌入块存储容量为 9Kbits,可配置成单 端口、伪双端口、真双端口以及 FIFO 缓冲器或者 ROM，通过配置可实现多 种数据  

  • 宽度最大支持 234Kbits 分布式存储器 

丰富的时钟资源 

  •  最大频率 Fmax=400MHz 

  •  最多可提供 16 个全局时钟，其中 8 个 可以复用为高扇出网络 

  •  提供多达 8 个专用时钟输入引脚 

  •  2 个 5 路时钟输出内置锁相环（PLL） 提供倍频、分频、相位转移等系统时 钟功能 

  •  2 个延时锁相环（DLL），提供分频、 相位偏移时钟功能

灵活强大的 I/O 单元

  •  最高可达到 335 个有效用户 I/O 

  •  支持 400Mbps DDR2 SDRAM 接口 

  •  支持 Generic DDRx1, DDRx2 

  •  输入输出支持 3.3/2.5/1.8/1.5V 电压 

  •  支持 MIPI，接口速率高达 1.2Gbps 

  •  I/O 支持标准单端, 差分, 伪双端包括 LVTTL、LVCMOS、SSTL, HSTL、PCI, LVDS、BLVDS、mini-LVDS、RSDS 

  •  6 个 IO 块(Bank) 

  •  15-33MHz 基准晶体震荡输人缓冲器 

  •  可配置上拉、下拉及总线保持模式 

  •  片内 100 欧姆差分电阻 

  •  支持热插拔

配置模式

  •  主模式(Active Serial AS) 

  •  从模式(Passive Serial PS) 

  •  自刷新配置(Self Refresh Configuration SRC) 

  •  JTAG 

  •  配置过程支持 SED/SEC 多比特流检测、 校验与单比特修正 

  •  配置过程支持多比特流加载，可在第 一个程序文件加载失败后，自动跳到 Golden 区域加载第二个程序文件

安全与 BSCAN

  •  支持 256 比特 AES 比特流加密及压缩 

  •  芯片拥有 64-bit UID 的 DNA 

  •  兼容 IEEE1149.1 Boundary Scan (BSCAN)

封装

  •  无铅封装 

  •  LQFP144 

  •  uBGA256 

  •  uBGA400


器件资源


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FPGA 无线 有线 广播 工业用户 通信 SL2E-7E/V FPGA SL2E-7E SL2E-7V 智多晶 管状电机

本文由小幸福转载自西安智多晶，原文标题为:Sealion（海狮）SL2E-7E/V FPGA 产品手册，本站所有转载文章系出于传递更多信息之目的，且明确注明来源，不希望被转载的媒体或个人可与我们联系，我们将立即进行删除处理。

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智多晶  -  现场可编程门阵列,FPGA,SA5Z-30-D1-U213,SA5Z-30-D2-U256,SA5Z-30-D2,SA5T-325,SA5Z-30-D3,SA5Z-30-D0,SA5Z-30-D1,SA5T-100,SA5T-366,SA5Z-50,SA5Z-30,SA5Z-30-D0-U324,SA5Z-30-D0-8U324C,工业控制,图像处理,人工智能,数据处理中心,无线通信,有线通信,云信息

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智多晶FPGA选型表

FPGA选型参数：28nm hpc+工艺，自 LUT6 架构，嵌入MCU，30K~325K LUT4，内置100/200/400个25X18/18X18/9X9专用乘法器，硬核 Memory DDR controller，PCIe-Gen2/3，1Mbps/s 采样，12bit ADC，支持 DDR4-1866Mbps，LVDS 1.25Gbps，Serdes 3.1Gbps~12.5Gbps，3D 合封 DDR2、DDR3 、DDR4

产品型号
品类
封装
LUTS
Flip-Flops
Slices
CLB
Flash(Kbits)
Max Distributed Ram (Kbits)
Embedded memory （Kbits）
Number of Block SRAM(9 Kbits/block)
Embedded 18x18multipliers
General purpose PLLs+DLLs
Global Clock Networks
User I/O Banks
Max user I/O(注1)
SL2E-5E-8W81I
FPGA
81-ball WLCSP,0.4mm
5040
5040
2520 (LUT:FF=1:1)
630
512
40
108
12
16
2+2
16
6
199

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