【经验】解析凌科芯安LKT6850安全MCU之系统架构
此前凌科芯安为大家详细地介绍了LKT6850安全MCU的特性及应用(凌科芯安新推32位MCU LKT6850,最高频率48MHz,可实现DES/3DES/AES/SM4等对称算法),相信大家都对这颗芯片有了一定的认识,那么本文中凌科芯安将从系统架构的角度再来为大家讲解该MCU芯片。
LKT6850主系统由以下部分构成:
两个驱动单元
ARM Cortex M0内核和系统总线(S-bus);
DMA总线。
三个被动单元
内部 SRAM;
内部闪存存储器;
AHB到APB的桥(AHB2APBx),它连接所有的APB设备这些都是通过一个多级的AHB总线构架相互连接的。
系统结构
系统总线
该总线连接ARM Cortex M0内核的系统总线到总线矩阵,各个高速部件间访问和内核由总线矩阵协调。
DMA控制器
此总线协调着CPU与各外设模块访问优先级,仲裁等。
总线矩阵
总线矩阵协调内核系统总线和DMA主控总线之间的访问仲裁,仲裁利用轮换算法。
AHB/APB桥(APB)
AHB/APB桥在AHB和APB总线间提供同步连接。
注意:当对APB寄存器进行8位或者16位访问时,该访问会被自动转换成32位的访问;桥会自动将16位或者8位的数据扩展以配合32位的宽度。
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