抖动性能可达到150fs以下的高效时钟解决方案

时间： 2019-07-03 来源：世强

技术问答

随着现代社会网络带宽的以及换联网基础设施和数据中心系统复杂度的增长，人们对时钟的频率、输出格式和电压也有了更高的要求。为了实现超高速网络，对于抖动性能的要求同样苛刻。由于传统时钟解决方案的灵活性和集成度的不足，硬件设计人员只能采用复杂的高成本时钟发生器和抖动衰减器组合方案来完成时钟树设计。SILICON LABS推出的Si5346/47抖动衰减器和时钟发生器，在单芯片上集成了分立时钟芯片功能，实现了一个简单高效的时钟解决方案。

Si5347作为一款高性能抖动衰减器和时钟倍频器，集成了4个独立抖动衰减PLL，可以适应任何晶体或参考时钟频率；Si5346则是更小封装的双DSPLL版本；基于第四代DSPLL技术，该芯片的抖动性能可达到150fs以下，每个DSPLL都可向外部设备提供低抖动时钟输出，支持独立运行、保持运行以及无中断自动输入时钟交换功能，Si5347/46带有非易失性存储器，可使用Silicon Labs公司的Clock Builder Pro进行编程，同样支持出厂预编。

图一1：Si5346/47内部结构

Si5346/47可应用于抖动性能要求苛刻光传输网络、无线基础设施、宽带接入/汇聚、数据中心设备（边缘路由器，交换机，存储和服务器）等。

Si5346特性如下：
• 2个PLL
• 4个时钟输入，4个时钟输出
• 输入频率为8KHz～750MHz
• 输出频率为1KHz～800MHz
• 封装为44QFN 7X7mm

Si5347特性如下：
• 4个PLL
• 4个时钟输入，8个时钟输出
• 输入频率为8KHz～750MHz
• 输出频率为1KHz～800MHz
• 封装为64QFN 9X9mm

Si5346/47应用领域如下：
• OTN复用转发器
• 以太网交换机
• 网络线路卡
• 视频广播
• 同步以太网

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NASA911 Lv8. 研究员 2017-12-15

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