【选型】集成OSC和PLL的XP系列时钟发生器在高速ADC电路中的设计选型

时间： 2019-08-20 来源：世强

技术问答

在高速ADC电路中，尤其是达到GSPS级别采样率的应用中，经常需要一个高速的时钟，作为ADC芯片的ADC采样时钟。该时钟的稳定度直接影响ADC芯片的采样结果。下图是该应用场景的框图：

该场景下，时钟的要求则非常的高，可以通过两种时钟发生方式，第一种是采用高精度晶振通过PLL倍频得到，该方案最少需要2个器件完成。第二种是使用集成OSC和PLL的时钟发生器产生。IDT（RENESAS 收购）的XP系列产品属于第二种方案，相对于第一种方案，XP系列有更加紧凑的空间、同时成本上也会有优势。而最大的优势在于XP在出厂时，会对输出的时钟进行校准，可以得到稳定且精确的时钟，同时IDT的这个产品可以支持IIC协议，用户可以通过IIC接口对内部输出频率进行调整，可以设置多组频率，进行切换。第一种方式是基于产品的指标叠加，在实际的调试过程中需要花费一定的精力进行调试，实际输出的高频时钟不一定能够满足叠加的指标。

以下是XP系列的主要参数：

输出信号类型：

在15MHz – 2100MHz频率输出范围：LVDS,LVPECL,CML

在15MHz – 725MHz频率输出范围：HCSL

工作电压：1.8v，2.5v，or3.3v

相位抖动（12kHz to 20kHz）：120fs

封装信息：

7.0*5.0*1.7mm

5.0*3.2*1.17mm

3.2*2.5*1.07mm

温度选项：

-40℃ to +85℃ ±25ppm

-40℃ to +105℃ ±50ppm

综上所述，使用IDT的XP系列产品能够在产品性能、空间、价格上有优势。在高速的ADC采样电路中，推荐使用该系列产品

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