【经验】高性能时钟扇出缓冲器8T39204晶振输入接口和上电斜坡序列设计参考

时间： 2019-12-26 来源：IDT（Renesas收购）

技术问答

IDT（被RENESAS收购）推出了一些高性能时钟扇出缓冲器，以8T39204为例。输入时钟可以从两个差分输入或一个晶体输入中选择。如果未选择晶振输入，则内部振荡器电路将自动禁用。晶体引脚可以由单端时钟驱动。所选信号分配到四个差分输出，可以配置为LVPECL，LVDS或HSCL输出。此外，还提供了LVCMOS输出。可以将所有输出禁用为高阻抗状态。该器件设计用于高频、低相位噪声时钟和数据信号的信号扇出。输入断开或接地时，输出处于定义的电平。它设计为使用3.3V或2.5V内核电源以及3.3V或2.5V输出工作电源供电。8T39204产品引脚如下：

图1 8T39204产品引脚图

本次分享晶振输入接口和上电斜坡序列设计的参考和经验。

晶振输入接口参考电路：

8T39204支持具有18pF并联谐振晶体，参考电路如图2。图2所示的电容值C1和C2是使用18pF并联谐振晶体确定的，选择该电容值可使ppm误差最小。

图2 18pF并联谐振晶体输入电路

此外，推荐另外一个12pF并联谐振晶体电路，如图3所示。可以针对不同的电路板布局稍微调整最佳C1和C2值。

图3 12pF并联谐振晶体输入电路

上电斜坡序列设计建议

该器件具有多个专用于不同模块的电源引脚。输出电源VDDOx（VDDOA，VDDOB，VDDOREF）必须在核心电源VDD之前或与之同时上升。所有电源必须以线性方式单调递增。

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