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在高频时钟信号的传输过程中,为避免影响信号完整性,使电磁波信号在系统中以最大功率输出,差分信号需要端接负载,做阻抗匹配。以下为LVDS、HCSL的端接匹配。
1、LVDS的输出需要保证负载端有100Ohm,可参考以下设计:
2、HCSL 要在靠近芯片端,电容前面下拉50Ohm电阻,可参考以下设计:
工程师们可以按照设计,可以最大化的发挥芯片的性能,减少后期验证设计的研发周期。
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