【经验】关于奥拉四通道抖动衰减时钟发生器Au5327高频差分信号端接匹配的设计方法

2022-06-15 世强
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奥拉Au5327是一款四通道抖动衰减时钟发生器,提供低于150fs相位抖动,支持SPI/IIC通信接口配置频率计划,也可使用奥拉烧录器固化,上电既有输出,差分输入输出支持8KHZ-2.1GHz,广泛应用于5G小基站RRU、BBU。

在高频时钟信号的传输过程中,为避免影响信号完整性,使电磁波信号在系统中以最大功率输出,差分信号需要端接负载,做阻抗匹配。以下为LVDS、HCSL的端接匹配。


1LVDS的输出需要保证负载端有100Ohm,可参考以下设计:

2、HCSL 要在靠近芯片端,电容前面下拉50Ohm电阻,可参考以下设计:

工程师们可以按照设计,可以最大化的发挥芯片的性能,减少后期验证设计的研发周期。

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