【产品】智多晶55nmFPGA芯片SL2E-7V-8U400，内置Flahs且支持分布式和嵌入式存储
为了更好让客户评估智多晶7K逻辑FPGA芯片，我们设计了一款可用于前期评估和移植验证的平台，该开发板的核心器件是西安智多晶的SL2E-7V-8U400，基于优化低功耗55nm工艺，可用于工业控制、视频接口处理等领域客户的前期评估。
开发板具有丰富的硬件资源和外围接口，秉承简洁、实用、可靠的设计原则，旨在引导广大客户快速熟悉智多晶的低功耗55nm工艺产品，对于有国产化需求的客户和在校大学生需要熟悉国产FPGA的，那么此开发板是一个非常合适的验证平台。下图为产品实物图。
特点
●智多晶55nmFPGA芯片：SL2E-7V-8U400。
●LUT4结构，等效逻辑单元：6864，可灵活的优化为LUT5/LUT6组合设计
●核电压：3.3V（SL2E-7E支持1.2V内核电压）
●内置Flahs：无需外部配置电路，支持快速上电启动，最大用户区域达500Kbits；同时板卡还外挂一个FLASH芯片，型号为W25Q64JVSSI，容量为64Mbits，接口为SPI。
●支持分布式和嵌入式存储：嵌入式存储容量为9Kbits，可配置为单端口、伪双端口、真双端口以及FIFO缓冲器或者ROM，通过配置可实现多种宽度，芯片支持最大234Kbits分布式存储器。
●丰富的时钟资源：FPGA最大时钟频率Fmax=400MHz，最多可提供16个全局时钟，其中8个可以复用为高扇出网络；FPGA提供多达8个专用时钟输入引脚，有2个5路时钟输出的内置锁相环（PLL）提供倍频、分频、相位转移等时钟系统，同时有2个延时锁相环（DLL），可提供分频相位偏移等时钟功能。
●灵活强达的IO单元：芯片支持最多335个有效用户IO,IO支持标准单端、差分，伪双端包括LVTTL、LVCOMS、SSTL、HSTL、PCI、LVDS、BLVDS、mini-LVDS\RSDS，具备6个IO BANK；IO端口可配置为上拉、下拉及总线保持模式，片内支持100欧姆差分电阻，支持热插拔。
●丰富的对外接口：21*2的2.54mm双排针，支持LVDS TX真差分接口；39*2的2.54mm双排针，支持LVDS RX真差分接口；20*2、27*2和41*2的2.54mm双排针，支持多达170个CMOS接口。
●多种时钟输入方案：板卡支持25MHz的单端时钟输入和25MHz的无源晶体时钟输入；另外，FPGA还支持OSC内部振荡器。
●丰富的板载控制接口及显示单元：8个LED，可显示用户调试信息；8个按键输入，可实现用户对系统的实时控制；板载LCD1602A高品质显示模块，提供机器与人的对话接口；Uart接口（Micro-USB）可以实现与外接的低速通信。
●支持宽压输入：5V~15V电压输入范围，可以满足不同的用户场景，电源输入接口支持DC-JACK和MicroUSB。
●*JTAG烧录与调试接口，拨码开关控制AS和PS启动模式。
●板卡尺寸：150mm*100mm。
开发板框图
注：开发板的时钟输入有2路：分别是TCXO 25MHz和XO 25MHz。
板卡引脚分配
1、时钟引脚
2、LCD1602A接口
LCD1602A通过编程可以显示用户信息，与FPGA连接的IO如下：
3、CMOS接口
板卡提供170个3.3V电平的CMOS接口，接口如下：
4、USB转串口
USB转串芯片用CH/340G，原理图连接如下：
5、按键
板上设计有8个按键开关，SW4~SW11，默认高电平，按下表示低电平。
6、LED指示灯
板上带有8个LED灯，可供用户做点灯指示，低电平灯亮。
7、LVDS_TX接口
板卡提供21对LVDS真差分输出接口，其连接图如下所示：
8、LVDS_TX接口
板卡提供39对LVDS真差分输入接口，其连接图如下所示：
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本文由放弃是坚强的第一课转载自智多晶，原文标题为:XSSL7-U400-V1开发板数据手册，本站所有转载文章系出于传递更多信息之目的，且明确注明来源，不希望被转载的媒体或个人可与我们联系，我们将立即进行删除处理。
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