【产品】2输出3.3V PCIe零延迟缓冲器9DBL0242/9DBL0252

时间： 2019-11-24 来源：IDT（Renesas收购）

技术问答

9DBL0242/9DBL0252 零延迟缓冲器是IDT（RENESAS收购）全功能PCIe系列的3.3V成员。这些设备支持PCIe Gen1-4公共时钟（CC）和PCIe分离式基准无关型扩频（SRIS）系统。其集成输出阻抗可以选择，可直接连接到85欧姆或100欧姆传输线。器件可在出厂前采用用户指定的上电默认SMBus配置进行设定。

推荐应用

PCIe Gen1-4时钟分配，用于转接卡，存储，网络，JBOD，通信，接入点等应用

输出特性

•2–1-200 MHz低功耗（LP）HCSL DIF

•9DBL0242默认Zout =100Ω

•9DBL0252默认Zout =85Ω

•9DBL02P2工厂可编程

•易于与其它逻辑器件进行交流耦合。请参阅IDT应用笔记AN-891

关键参数

•ZDB模式下兼容PCIe Gen1-2-3-4 CC

•ZDB模式下兼容PCIe Gen2 SRIS

•在扇出模式下支持PCIe Gen2-3 SRIS

•DIF周期抖动<50ps

•DIF输出到输出偏斜<50ps

•旁路模式附加相位抖动对于PCIe为0 ps（典型值）

•旁路模式156.25M (1.5M to10M)时附加相位抖动111fs rms typ.

特点/优势

•直接连接到100Ω（xx41）或85Ω（xx51）传输线；与标准PCIe设备相比节省了8个电阻

•PLL模式下的典型功耗为100mW；最低功耗

•SMBus可选功能可优化满足客户要求：

–控制输入极性

–控制输入上拉/下拉

–每个输出的压摆率

–差分输出幅度

–每个输出的输出阻抗

– 50、100、125MHz工作频率

•客户定义的SMBus上电默认设置可以编程到P1设备中；允许对客户要求进行精确优化

•OE＃引脚；支持DIF电源管理

•兼容HCSL的差分输入；可以由通用时钟源驱动

•扩频；可以降低EMI

•引脚/ SMBus可选的PLL带宽和PLL旁路；最小化每种应用的相位抖动

•输出被阻塞直到PLL锁定；清洁系统启动

•设备包含默认配置；设备操作不需要SMBus接口

•三个可选的SMBus地址；多个设备可以轻松共享一个SMBus段

•节省空间的24pin4x4mm VFQFPN；最小化电路板空间

框图

注意：在xx42 / xx52设备上，电阻默认为内部电阻。 P2设备具有逐个输出的可编程默认阻抗

引脚分布

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