内存DDR4信号一致性眼图测试的案例分享
一、DDR4 信号完整性测试要求
在 DDR4 规范 JESD79‐4 中，对物理层信号测试要求有：DQ眼图模板测试、抖动分析、电气特性测试，时序测试。相比 DDR3，DDR4 对眼图测试和抖动测试提出了新的要求。
抖动测试
在DDR4的规范中，采用了更实际的方法来考虑这些因素，测试要求包含了随机抖动Rj和确定性抖动Dj，在规范中，总体抖动 Tj 被定义为在一定误码率下的确定性抖动Dj和随机性抖动Rj的和，对抖动做了分解。
图 1
眼图模板测试
在 DDR3 测试中，眼图只是作为一个 Debug 的手段，不是强制要求测试，而且没有模板。但是在 DDR4 中，要求进行 DQ 输入接收端眼图模板测试，下图是眼图模板的定义，在 DDR4‐2133 及以下频率，TdIVW_total 和 TdIVW_dj 相等。VdIVW_total 和 VdIVW_dV 相等，从本质上，现在还没有在模板中定义随机成分。
图 2
二、DDR4 测试点选取原则
DDR测试点选取的一般原则，即：测读信号尽量靠近CPU，测量写信号尽量靠近RAM。
首先，考虑到走线对信号的衰减，一般在靠近芯片的接收侧对信号进行量测，这样，“看”到的信号和芯片“看”到的信号会更加接近。其次，这样也会减小反射。
探头的接入或多或少会导致接入点的阻抗产生变化，原本100Ω左右的差分对走线在探头连接处变成其他的值（例如50Ω），这样信号会在这个点产生反射。一般DDR的接收端阻抗的连续性没有发送端好，所以信号在接收端也会产生反射。
如果信号前进过程中两个反射点离得比较远，距离(单位为inch)>信号的上升时间(单位为ns)，会对信号产生比较明显的影响，如果量测到的信号在上升沿有回沟或者在信号高低电平中间有凹陷，这些都是多次反射造成的。
建议探头的连接点在DDR信号的接收端，能减少这样多次反射带来的影响。
三、DDR4 眼图测试案例
图 3
启威测实验室提供DDR2/3/4/5以及LPDDR4信号完整性测试及一致性验证，更多关于DDR测试解决方案，请联系平台。
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