【应用】国产奥拉半导体Au5426时钟缓冲器用于5G通信小基站，支持4差分输出，具有超低抖动性能

时间： 2022-08-17 来源：世强

技术问答

随着互联网通信技术的高速发展，人们在享受着高速信息交互和万物互联的大数据时代带来的便利的同时，也对互联网产生了极高的依赖性，无论是足不出户的网上购物、工作社交和日常娱乐，都已渐渐离不开对网络的依赖，因此，对网络信号覆盖的建设，也是影响人们生活体验的重要需求。

目前，致力于满足更高通讯速率需求的5G通信基站已大范围铺设和推广，除了宏基站等中大型基站的信号大范围覆盖，对于一些较为拥挤的办公大楼、商场等大型楼宇的建筑布局、楼层高低以及建筑结构，会影响网络设备对外发射信号以及对基站信号的接收，严重影响网络通信的质量，因此，针对大型楼宇，5G通信小基站应运而生。

5G通信小基站的一般架构为BBU+AAU/RRU，其中BBU由主控传输单元、基带处理单元、交换单元、存储单元、电源模块、时钟模块等组成，AAU单元由接口模块、基带处理单元、数字中频模块、收发信机、功放/低噪放、双工器、天线等组成，系统框图如下：

BBU的主控传输单元与基带处理单元往往需要大量的信息交互处理以及高频的数据传输，与外围设备通信的数据总线一般会用到PCI-e总线，为CPU提供高速的点对点双通道高带宽数据传输，例如BBU中的内存模块、桥接芯片、网卡等PCI-e设备。由于处理器本身不能提供PCI-e时钟，需要外部器件来提供100MHz的时钟信号，通常采用专用逻辑向PCIe插槽提供REFCLK+和REFCLK-信号，如下图所示，100Mhz的时钟源由晶振提供，经过一个“一推多”的时钟缓冲器生成多个同相位的时钟源，与PCIe插槽一一对应连接。对于PCI-e设备要求数量不多的小基站，时钟缓冲器的选择推荐国产奥拉半导体的Au5426时钟缓冲器，4差分输出和1 LVCMOS输出超低抖动的优秀性能，适用于5G小基站信号处理板的PCI-e时钟分配。

Au5426具备以下优势：

1、超低的输出抖动性能，50fs RMS，满足系统时钟的稳定性和可靠性；

2、三个可选输入通道，输入时钟兼容LVPECL, LVDS, LVCMOS, SSTL, HCSL and XTAL等多种格式，适应多种形式的时钟输入，方便系统设计；

3、支持DC to 2100MHz的宽输出范围，满足不同系统的频率输出要求；

4、 5mmx5mm WQFN小封装，适用于对空间由限制要求的应用条件。

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