【经验】芯科科技8bit单片机C2通信接口烧录指南

2021-12-30 世强
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本文主要介绍芯科科技的(SILICON LABS8bit单片机,调试烧录过程中遇到的一些不稳定问题,以及工厂生产批次不良率分析处理。原厂仿真器订购型号DEBUGADPTR1-USB又称UDA目前最新的是第三代。


此款仿真器产品使用两线通信,可以提供映射引脚复用的功能。由于芯科单片机C2端口类型使用的是漏极开路模式,C2D端口可以支持双向的数据输入和输出,C2CK主要用来提供通信时钟。仿真器设计上,可以提供5V电源。3.3V可以在仿真器内部供电电容取电,飞线到第1个空引脚。方便仿真器烧写目标板时,选择5V和3.3V直接供电,不超过100mA。


仿真器和引脚定义如下图所示:

仿真器和目标板单片机可以复用C2端口,映射端口功能。也可以不做复用直接连接。典型设计电路如下图所示,红色连线表示不做复用功能直接调试。C2CK上拉电阻R3,厂家强烈建议使用1K电阻。如果复用端口功能,R1和R2需要配置,详细可以查阅相关文档AN124和AN127,这里不再赘述。

问题1、C2D引脚时序爬升过缓,导致通信不稳定问题。可以在仿真器或者连接器上修改,强烈建议上拉1K电阻,增强驱动能力。因为这个口是漏极开路,靠上拉电阻才能有高电平。芯片自带内部弱上拉,范围比较宽20~200K每批次都不等,大批量生产靠不住,很多用户在加工厂遇到此问题,有的反馈不良率达到5%~10%,通过修改烧写工具工装已解决。这部分典型电路没有提醒,一般在研发阶段不容易发现,经常使用的也就几块板子。


问题2、C2CK引脚时序爬升过缓,方波被圆弧倒角,或者高低电平达不到识别门限。检查外加上电复位电路或者复位芯片导致时钟线时序异常。例如,大多数用户外加了阻容上点复位电路,电阻一般都是选10K~100K(典型电路强烈建议1K上拉),电容0.01uF~0.1uF。阻值过大或者精度太差都会导致电路参数偏移,影响C2CK信号质量。一些用户还增加复位芯片,来控制上电复位时序。芯科8bit单片机芯片内部本身带有硬件复位电路POR/Brownout Detector,也可以作为输出功能使用,相当于内部集成了上电复位和掉电复位芯片。如果不考虑系统多芯片,上电顺序的问题,用户大可放心使用芯片内部复位功能,外部上拉1K电阻完事。如果用户板子已经批量生产,遇到部分烧录不良问题,也可以在仿真器上修改,上拉1K电阻到3.3V,增强驱动能力和电路参数的偏移。


问题3、仿真器到目标板连接线要尽可能的缩短,避免引入干扰,导致信号不稳定,强烈建议不超过20cm。电源供电不足也会导致操作过程中影响数据信号线波动,识别不准高低电平影响稳定性。有些用户在芯片供电上,串联了二极管,压降过大导致高电平信号不匹配问题等。


如果遇到芯科科技8bit单片机烧录问题,可以从以上几点进行排查,从最可能影响时序的地方入手。批量烧写问题基本上通过修改工装连接器或者改造仿真器解决。研发过程中遇到问题,参考典型电路设计。

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全部评论(1

  • 用户38320701 Lv2 2022-03-14
    是否有代烧录服务啊?
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