【经验】瑞萨R CAR E3安全访问寄存器资源实操

2021-08-30 世强
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瑞萨R CAR E3使用中用到了其中R7核以及A53核,分别跑autosar和linux(QNX),在同时运行Autosar和linux过程中,R7核这边用到以太网,A53核没有用以太网,会出现R7核挂死现象,所以怀疑跟寄存器的共同访问冲突有关系,本文测试了GPIO寄存器的安全访问。


首先看一下R CAR的寄存器资源安全访问的控制模块life Cycle情况:


这个模块主要是通过控制master,slave总线的安全级别来实现模块的访问,总共有5个安全优先级别,分别是secure,以及3,2,1,0等级从高到低:


可以看到Master Security Group中,AxPROT[1]=0为secure最高访问等级,此时SECGRP1CR,SECGRP0CR无需设置,不用管,而对应的Slave Security Groupy也分为secure等级和no-secure访问等级,其中no-secure访问等级又分为4种,分别是SECGRP1COND,SECGRP0COND的4种组合11,10,01,00,同时搭配SEC_READONLY来控制访问;


其中Master Security Group中的10(group2),01(group1)没有使用。


以下是slave bus端的说明:


可以知道,每一个模块的访问权限都会有2个SECGRP1CR,SECGRP0CR和2个SECGRP1COND,SECGRP0COND以及一个SEC_READONLY来共同控制。



这是一个LIFEC控制访问AXI Master,A57,A53,R7核总线优先级等级,以及AXI-SLAVE总线访问优先级的示意图。


这个图的意思为AxPROT[1]=0时,master端为最高优先级访问等级secure。此时A53,A57,R7,AXI Master作为最高访问优先级端可以访问bus slave端的任意等级,当然需要设置SEC_SEL对应的bit为0,即为secure模式,就可以访问bus slave端的secure,以及no-secure模式的等级的总线设备,而设置SEC_SEL=1为非secure等级的master端无法访问secure的bus slave端。


这个图的意思是当AxPROT[1]=1时,master总线端的访问等级有4组非secure的总线访问组,分别为2个SECGRP1CR,SECGRP0CR和2个SECGRP1COND,SECGRP0COND所组合的11,10,01,00,等级从高到低;其中11(GROUP3)为no-secure中的最高访问等级,只能从更高的secure的master端来访问,而无法从低等级01(GROUP1)master总线来访问;当然从01(GROUP1)master总线来访问00(GROUP0)bus slaves是能成功的。


下面,我们来通过IPL代码中Bl2_Secure_setting.c来修改对应的master组SECGRP1CR,SECGRP0CR,以及Slave组SECGRP1COND,SECGRP0COND等模块总线访问等级,从而验证LIFEC的作用:


我们先修改GPIO5的SEC_SEL15的bit1为0,即设置为secure,最高访问等级。




编译生成bl2.srec,bl31.srec后烧录到R CAR E3,运行到uboot后,运行md e6055000,打印如下:


而默认的bl2.srec烧录后,是可以正常读写GPIO5对应的寄存器资源的:


说明默认的IPL代码中master端AxPROT[1]为1,否则AxPROT[1]为0,当slave bus设置为secure时也应该是可以正常读写GPIO5对应的寄存器资源的;


基于以上测试,我们判断出来IPL代码默认AxPROT[1]为1,所以就采用no-secure等级来控制master和slave总线访问等级。


下面我们把GPIO5设置到no-secure,SEC_SEL15的bit1为1,寄存器描述为可以从所有资源都可以访问,但其实也是需要比较master端的访问等级和Slave的等级来做访问的,只有master端的访问等级高于Slave的等级才能成功访问:


把GPIO5的slave总线设置为01,即slave总线访问等级为1,我们再来测试把A53,A57等级分别设置为11,00来确认是否能读写GPIO5的寄存器资源:


当修采用默认的A53,A57等级00,我们编译以上修改后的IPL,烧录运行到uboot,采用md e6055000,打印如下:


然后修改A53,A57 Master等级为11,再编译生成bl2.srec:


运行到uboot,采用md e6055000,打印如下:


以上详细说明了瑞萨R CAR E3安全访问寄存器资源的控制模块lifec,并且通过实际修改IPL代码中lifec寄存器实现A53核访问GPIO5寄存器资源的控制,这样我们就可以实现R CAR E3的各个模块的资源使用开关了,从而使资源不会发生冲突。



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