【经验】Renesas可编程时钟发生器5P49V60用CLKIN实现单端输入的参考设计

时间： 2020-01-15 来源：Renesas

IDT（RENESAS收购）推出的5P49V60是VersaClock®6E可编程时钟发生器系列产品。 5P49V60适用于信息娱乐、仪表板、视频处理、车载网络等汽车应用，以及基于PCI-Express或USB3.0的应用。参考时钟可以来自两个冗余时钟输入之一。无故障手动切换功能允许在正常操作期间选择冗余时钟之一。配置可以存储在片上一次性可编程（OTP）存储器中，也可以使用I²C接口进行更改。

5P49V60的时钟输入有多种方式，支持晶体振荡器接口输入、单端CMOS时钟输入和差分时钟输入。

本文介绍5P49V60连接CLKIN引脚以实现单端输入参考设计，如图1。

由于内部的1.2V稳压输入，CLKIN不能接受大于1.2V pk-pk的信号。但是，它内部是交流耦合的，因此能够接受LVDS和LVPECL输入信号。

有时，希望使CLKIN达到CMOS电平，以下叙述的是如何实现此目的的示例。

此配置具有三个属性：

1. Ro和Rs的总输出阻抗与50Ω传输线阻抗匹配。

2. CLKIN处产生Vrx电压，该电压可保持传输线上的LVCMOS驱动器电压电平，以获得最佳S / N。

3. R1-R2分压器值确保CLKIN的Vrx p-p小于1.2V的最大值。

图1 LVCMOS驱动器驱动CLKIN原理图

表1列出了确保在驱动器VDD，VDDO0和5％电阻容差均为5％公差的所有组合下都不会超过CLKIN端口的最大驱动电平的电阻值。可以通过增加R1-R2分压器的阻抗来调节电阻的值，以降低较慢和较弱的LVCMOS驱动器的负载。为了更好地帮助进行此评估，表中包括了驱动器上的总负载（Ro + Rs + R1 + R2）。

表2 单端驱动器过驱动CLKIN的标称分压器值

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