【经验】关于SI53159输入及输出端接电路设计的几点注意事项

时间： 2021-04-28 来源：世强

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SI53159是SiliconLabs推出的一款PCI-Express Gen 1/2/3/4/5的1：9时钟扇出缓冲器，符合Intel DB1900Z规范的所有性能要求。对面向Intel® 超级通道和快速通道互联 (Intel UPI/QPI)、PCIe Gen 1/2/3/4/5、SAS、SATA 和 Intel 可扩充内存互连 (Intel SMI) 应用分配一路优化的参考时钟。每个差分输出均可通过单独硬件引脚使能控制，方便不同场景选取时钟，节省功耗设计。

近日有工程师在使用SI53159碰到一些问题，主要表现在后端PCIe器件无法通过系统正常识别。通常是什么原因导致后端PCIe接收器件无法被识别呢？一般是匹配的问题所导致，因此必须选择正确的匹配端接电路。

首先是输入端接电路，如果SI53159的上游器件是HCSL标准电平格式输出，那么可以直接用耦合的方式接入到SI53159，但是现在很多器件不是这种格式，比如LVDS格式，这时芯片时钟输入则需要增加对应的匹配电路，主要是为了调整偏置幅度需求，达到SI53159的电气设计输入要求。

然后是输出端接电路。前期该客户使用过CY28400，这一版PCB按照CY28400的评估板做的参考设计来设计SI53159，CY28400是SILICON LABS早期的一款支持PCIe的时钟缓冲器，主要用于早期PCIe和SATA接口参考时钟分发设计，目前已经停产，目前在使用与SI53159同系列的SI53154替代，与最新SI53159的参数有很多不同，表现在输出端接电路匹配上有很大差异，所以在设计时不能直接沿用以前的设计。

这里有两点需要引起注意：一点是SI53159后端接收器是HCSL电平格式的PCIe接收器，这时可以直接DC耦合端接即可，因为SI53159内置了33欧姆和50欧姆的端接电阻，而CY28400是不集成这些端接电阻的；另外一点就是对于后端接收器不是HCSL标准电平格式的，需要对相关电路进行转换，可以参考AN781文档。比如对于输出是LVDS格式的电平PCIe接收器，建议按如下电路进行转换。

图1 HCSL转LVDS接收器转换电路（接收器已内置100欧姆电阻）

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型号- SI5386,SI5384,OG1409CAN,CX3225SB,SI5386E,ATGM3331C-5T31

EPSON,KYOCERA,SILICON LABS - 优选器件方案 - V1.1

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As an outstanding electronic components distributor, Sekorm welcomed a new partner-Silicon Labs. At the same time, Sekorm is also the largest agent of Silicon Labs in China.

2021-12-01 - 公司动态代理服务技术支持批量订货