【应用】互联网基础设施(II)应用时钟​设计人员选择Si534x抖动衰减器的三大原因

2019-01-24 Silicon Labs
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随着互联设备和云服务使用的增加,用户对视频流、移动新闻馈送、数据存储等各种互联网内容要求新颖且多样化的服务。数据服务需要许多不同的时钟,对于时钟树设计人员来说,使互联网基础设施(II)应用更简单、更快和更可靠是具有一定挑战性的。

 

SILICON LABSSi534x输出高性能抖动衰减器结合了第四代DSPLL和MultiSynth技术,帮助需要最高抖动性能的应用实现了任意频率时钟发生和抖动衰减。该设备拥有0.09 ps rms相位抖动,误差为0ppm。环路滤波器完全集成在芯片上,消除了与离散解决方案有关的噪声耦合风险。此外,抖动衰减频宽可进行数字编程,提供应用级的抖动性能优化。Si534x抖动时钟系列旨在帮助设计人员满足互联网基础设施(II)应用的高性能和易用性要求。让我们看看为什么时钟设计者选择Si534x抖动衰减器而不是其他竞争产品的主要原因。

 

原因一适合任何频率

FPGA,ASIC和PHY都需要多种频率和格式组合,以满足边缘路由器,存储器,服务器和交换机等各种服务的需求。在传统方法中,抖动时钟系列仅支持特定输出上的特定频率。 Si534x抖动时钟通过在任何输出上生成任意频率组合,在不损害相位抖动性能的情况下具有业界领先的频率灵活性。

 

原因二一流的集成

MultiSynth技术简化了通信、存储和广播视频应用中的时钟生成。Silicon Labs的此项专有技术是支持相位误差纠正的低抖动小数分频器。采用MultiSynth技术的时钟产生器可在单个设备中产生多个非整数相关的输出时钟,从而不再需要独立的晶体振荡器和时钟产生器集成电路。MultiSynth方法采用专利的相位误差消除电路,以非常低的抖动(1 ps rms典型值)提供任意速率频率合成。它可以实现单个IC时钟树,而无需许多分立元件。芯片上的时钟树集成降低了材料清单(BOM)成本并简化了时钟设计。



图1 MultiSynth技术

 

原因三:直观的ClockBuilder Pro软件

我们还提供ClockBuilder Pro,以便快速轻松地进行评估。 使用ClockBuilder Pro,时钟设计师可以在几分钟内创建优化的自定义时钟。ClockBuilder Pro可验证您的频率规划,测量时钟性能并自动生成可订购的部件号,以便设计人员可在2周内获得工厂定制的样品。

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