【经验】一文讲述高性能时钟树设计原则、参考时序、自由运行和同步时钟树对比
SILICON LABS(亦称"芯科科技")近期发布了多款时钟系列产品,可以满足数据中心和通信设备对高性能、低功耗计时解决方案的严格要求。
时钟树设计原则
在高性能应用中,例如通信、无线基础设施、服务器、广播视频以及测试和测量装置,当系统集成更多功能并需要提高性能水平时,硬件设计就变得日益复杂,为系统提供参考时序的板级时钟树也走向这种趋势。在进行时钟树设计时,"一成不变"的策略并不适用,优化时钟树以满足性能和成本的要求取决于多种因素,包括系统架构、集成电路(IC)时序需求(频率、信号格式等)和终端应用的抖动需求。
参考时序-何时使用晶体或时钟
第一个设计原则是理清硬件设计的参考时钟需求,并选择用于系统中处理器、FPGA、ASIC、PHY、DSP和其他组件的参考时钟类型。如果IC已集成振荡器和片上锁相环(PLL)用于片内时序,那么通常可以使用石英晶体。石英晶体具有成本效益,因其优异的相位噪声特性而被广泛使用,他们放在靠近IC的地方,以简化电路板布局。然而,晶体的缺点之一是在整个温度范围内频率有显著变化,超出许多串化器/并化器(SerDes)应用中高精度ppm等级的稳定性需求。在许多要求高稳定性的高速SerDes应用中,推荐使用晶体振荡器(XO),因其可以确保比无源晶体更可靠的稳定性。
当需要多个参考频率时,通常使用时钟发生器和时钟缓冲器。在某些应用中,FPGA/ASIC有多个时钟域用于数据通路、控制平面和存储控制器接口,需要多个特定参考频率。如果IC不提供晶体输入接口,或者当IC需要与外部参考(同步源应用)同步时,又或者当所需高频参考值很难由晶体生成时,时钟发生器和缓冲器也是优先选择。
自由运行对比同步时钟树
一旦硬件设计确定下来,并且为部分器件选择了晶体,接下来的步骤就是为剩下的时钟选择时序架构:自由运行或同步。对于需要一个或多个独立参考时钟,且没有任何特殊锁相环或同步需求的应用来说,XO、时钟发生器和时钟缓冲器是理想选择。处理器、存储控制器、SoC和外围组件(例如,USB和PCIExpress转换器)通常使用XO、时钟发生器和时钟缓冲器组合,为自由运行和异步的应用提供参考时序。
如果应用需要一到两个定时源,XO是最好的选择;而时钟发生器和缓冲器更适合同时需要多个独立时钟的应用。时钟发生器能够合成多个不同频率的时钟,但与由时钟缓冲器加上XO组成的时钟树相比,牺牲部分抖动性能。时钟缓冲器可以与XO参考联合分配多个相同频率的时钟,并且为多输出时钟树实现最低抖动。
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MagicMoon Lv8 2018-09-18学习
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用户18396822 Lv8 2018-07-15支持
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海锋 Lv9. 科学家 2018-04-01学习了
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用户67900951 Lv5. 技术专家 2017-12-14nice
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用户67900951 Lv5. 技术专家 2017-12-14nice
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duanmaxie Lv8. 研究员 2017-11-01不错哦
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