【经验】高性能抖动衰减器时钟芯片Si5326的频率配置问题解析及替代方案推荐

时间： 2020-03-10 来源：世强

技术问答

Si5326是SILICON LABS推出的基于第三代DSPLL专利技术的高性能抖动衰减器时钟芯片，推出时间较长，在各种通信设备、医疗仪器、工业控制等行业有较多的应用，是Silicon Labs曾经的明星产品，因为及成熟的性能，且各大公司都已经编进了BOM表，目前仍然有较多的设计在使用Si5326，随后Silicon Labs继续发挥其在抖动技术上的优势，及时的推出了Si534X及Si539X的产品，这些产品都是基于最新的第四代DSPLL核心专利技术开发的，消抖性能进一步提升。但是仍然有许多工程师在使用Si5326，特别是一些老的产品的升级。

日前，有工程师在使用Si5326配置时钟频率计划的时候，发现了存在部分频点无法输出的问题，我们来看看是怎么一回事：该工程师要求Si5326输入为25MHz时钟，2路输出分别是25.8MHz和27.5MHz的3.3V时钟信号，使用DSPLLsim配置时，发现无论该2路时钟位置如何调换，无论如何调整分频比，输出频点都不能同时实现整个两个频点的输出，因此怀疑任意频点输出的描述是否准确。

经过使用DSPLLsim配置用户所需的频点，确实存在该问题，仔细分析原因，这是因为其VCO的参考时钟Fosc已经固定为5.16GHz，且鉴相器频率调整对NC1_LS和NC2_LS的影响不大，同时NC1_LS和NC2_LS只能以2的整数倍进行调整，从下图1所示，其CKOUT1和CKOUT2的频率必须成一定的关系根据VCO有一定的约数关系，很明显是不能同时出25.8MHz和27.5MHz两个频点，如果执意配置，可能有较大的频偏，精度得不到保证。当然，如果使用Silicon Labs的内部未开放配置可能会可以配置输出，不过输出频偏可能较大。

图1 CKOUT1和CKOUT2配置框图

实际上从很多以往的Si5326应用来看，其两路输出频点都会存在一定的关系，大部分应用都是1:1输出，因此不会存在这种问题。碰到上述这种情况，我们其实可以选择性能比SI5326更好的抖动衰减器Si534x来实现，相对于Si5326，其内部DSPLL的配置更为灵活，使用CBPro软件，可以方便的配置出这些频点，注意这两个频点存有一定的串扰，需要隔开处理，可以选择Si5344，如下图。

图2 基于SI5344的详细设计

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