【经验】奥拉Au5329时钟发生器JESD204B SYSREF时钟输出的寄存器配置方式
奥拉Au5329是可编程的双通道时钟抖动衰减器,广泛应用于5G小基站,支持JESD204B,可实现通信系统中的多设备同步,通过配置PLLB、PLLD输出5个DCLK、Sysref对,即支持多达5个JESD204B目标。
Sysref时钟需要在GUI配置上勾选Sysref,否则就是普通时钟输出,这和DCLK有相位关系,时钟发生器Au5329可输出单个或多个DCLK时钟宽度,某客户在勾选GUI上的Sysref后仍无时钟输出,这应该怎么解决?
Au5329在GUI勾选Sysref后需要用GPIO或寄存器配置去触发才会有输出,下面将介绍用寄存器配置触发Sysref时钟输出的方式。
1、Go to Page 0 reg 19h and configure the SYSREF Trigger
i2c.i2cw(0x69,0xff,0x00)
i2c.i2cw(0x69,0x19,0x20)
2、Do a small trigger after updating the Reg 19h on Page 0 as below:
i2c.i2cw(0x69,0x0f,0x00)
i2c.i2cw(0x69,0x0f,0x04)
i2c.i2cw(0x69,0x0f,0x00)
3、Go to the PLL Page from where the SYSREF clock needs to be generated:
i2c.i2cw(0x69,0xff,0x0b)
4、 Reg 09h can be used to select the SYSREF Output which is controlled through SYSREF trigger:
i2c.i2cw(0x69,0x09,0x0a)
5、Reg 05h can be used to set the SYSREF Trigger ON and OFF:
SYSREF Trigger ON: i2c.i2cw(0x69,0x05,0x02)
SYSREF Trigger OFF: i2c.i2cw(0x69,0x05,0x00)
以上为配置Sysref时钟输出的例子,在实际应用中可根据具体的GUI配置,修改相对应的寄存器即可,可缩短工程师在初次使用奥拉Au5329时的研发周期。
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产品型号
|
品类
|
供电电压(MHz)
|
相位噪声(fs)
|
输入/输出
|
封装类型
|
AU5424BG-DNR
|
时钟驱动器
|
≤200MHz
|
<50fs 附加抖动
|
1:4 LVCMOS 缓冲器
|
8-DFN
|
选型表 - 奥拉 立即选型
Aura Timing Product Overview
型号- AU5424,AU5325,AU5425,AU5426,AU5327,AU5327BC1-QMR,AU53X7,AU5325BC1-QMR,AU5315,AU5508,AU5317,AU5508 SERIES,AU5315AC0-QMR,AU5328,AU5329,AU5329B-QMR,AU5325BC2-QMR,AU5411A-QMR,AU5327BC2-QMR,AU53X5,AU5410,AU5411,AU5615,AU5424G,AU5617,AU5317AC0-QMR,AU5424A,AU53X7 SERIES,AU5410A-QMR,AU53X5 SERIES
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现货市场
服务
提供是德(Keysight),罗德(R&S)测试测量仪器租赁服务,包括网络分析仪、无线通讯综测仪、信号发生器、频谱分析仪、信号分析仪、电源等仪器租赁服务;租赁费用按月计算,租赁价格按仪器配置而定。
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实验室地址: 深圳/苏州 提交需求>
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