【经验】奥拉Au5329时钟发生器JESD204B SYSREF时钟输出的寄存器配置方式
奥拉Au5329是可编程的双通道时钟抖动衰减器,广泛应用于5G小基站,支持JESD204B,可实现通信系统中的多设备同步,通过配置PLLB、PLLD输出5个DCLK、Sysref对,即支持多达5个JESD204B目标。
Sysref时钟需要在GUI配置上勾选Sysref,否则就是普通时钟输出,这和DCLK有相位关系,时钟发生器Au5329可输出单个或多个DCLK时钟宽度,某客户在勾选GUI上的Sysref后仍无时钟输出,这应该怎么解决?
Au5329在GUI勾选Sysref后需要用GPIO或寄存器配置去触发才会有输出,下面将介绍用寄存器配置触发Sysref时钟输出的方式。
1、Go to Page 0 reg 19h and configure the SYSREF Trigger
i2c.i2cw(0x69,0xff,0x00)
i2c.i2cw(0x69,0x19,0x20)
2、Do a small trigger after updating the Reg 19h on Page 0 as below:
i2c.i2cw(0x69,0x0f,0x00)
i2c.i2cw(0x69,0x0f,0x04)
i2c.i2cw(0x69,0x0f,0x00)
3、Go to the PLL Page from where the SYSREF clock needs to be generated:
i2c.i2cw(0x69,0xff,0x0b)
4、 Reg 09h can be used to select the SYSREF Output which is controlled through SYSREF trigger:
i2c.i2cw(0x69,0x09,0x0a)
5、Reg 05h can be used to set the SYSREF Trigger ON and OFF:
SYSREF Trigger ON: i2c.i2cw(0x69,0x05,0x02)
SYSREF Trigger OFF: i2c.i2cw(0x69,0x05,0x00)
以上为配置Sysref时钟输出的例子,在实际应用中可根据具体的GUI配置,修改相对应的寄存器即可,可缩短工程师在初次使用奥拉Au5329时的研发周期。
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供电电压频率(≤250MHz),相位噪声(<50fs),输入/输出,封装类型,输出频率范围(0.5 Hz-2.94912 GHz),输出电流(A),频率,输出精度,静态电流,噪音,压降,电源抑制比
产品型号
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品类
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供电电压(MHz)
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相位噪声(fs)
|
输入/输出
|
封装类型
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AU5424BG-DNR
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时钟驱动器
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≤200MHz
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<50fs 附加抖动
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1:4 LVCMOS 缓冲器
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8-DFN
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选型表 - 奥拉 立即选型
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