【产品】4输出3.3V LP-HCSL零延迟缓冲器9DBL0453、9DBL0443，具有信号丢失（LOS）指示器

时间： 2019-11-21 来源：IDT（Renesas收购）

IDT（RENESAS收购）推出的零延迟缓冲器 9DBL0453、9DBL0443产品属于IDT 3.3V 全功能PCIe时钟系列。两个产品都具有信号丢失（LOS）指示器，可支持容错的高可靠性系统；都支持PCIe Gen1-4通用时钟（CC）架构，还支持NVLink应用程序。它可用于扩展卡、存储、网络、JBOD、通信、接入点等PCIe Gen1-4和NVLINK时钟分配。

输出功能

▪ 信号丢失（LOS）开漏输出

▪ 4组1-200 MHz低功耗（LP）HCSL 差分时钟（DIF）对

▪ 9DBL0443默认Zout =100Ω

▪ 9DBL0453默认Zout =85Ω

▪ 易于将AC耦合到其他逻辑系列，具体请参阅IDT应用笔记AN-891

关键规格

▪ ZDB或扇出缓冲模式下符合PCIe Gen1-4 CC

▪ ZDB或扇出缓冲模式下支持156.25M的NVLINK

▪ DIF周期抖动<50 ps

▪ DIF输出到输出偏斜<50 ps

▪ PCIe的旁路模式加性相位抖动典型值为 0 ps

▪ 旁路模式加性相位抖动典型值为160fs rms。 @ 156.25M（1.5M至10M）

图1：9DBL0453器件框图

图2：9DBL0443器件框图

特点/优势

▪ LOS指示器指示输入时钟丢失；增加容错能力，简化系统诊断

▪ 直接连接到85Ω（xx53）传输线；与标准PCIe设备相比节省了8个电阻（9DBL0453）

▪ 直接连接到100Ω（xx43）传输线；与标准PCIe设备相比节省了8个电阻（9DBL0443）

▪ PLL模式下的典型功耗为134mW；消除热问题

▪ 每个DIF输出的OE＃引脚；支持DIF电源管理

▪ 兼容HCSL的差分输入；可以由通用时钟源驱动

▪ 耐扩频；可以降低EMI

▪ 输出被阻塞直到PLL锁定；清洁系统启动

▪ 引脚/ SMBus可选的PLL带宽和PLL旁路；最小化每个应用的相位抖动

▪ 设备包含默认配置；设备操作不需要SMBus接口

▪ 3个可选的SMBus地址；多个设备可以轻松共享SMBus段

▪ SMBus可选功能可根据客户需求进行优化：

▪ 控制输入极性

▪ 控制输入上拉/下拉

▪ 每个输出的摆率

▪ 差分输出幅度

▪ 每个输出的输出阻抗

▪ 可通过与IDT联系实现快速定制SMBus默认值；允许精确优化客户要求

▪ 节省空间的32引脚5×5mm VFQFPN；实现最小的板空间

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全部评论（1）

LouBing Lv7. 资深专家 2019-11-22

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